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Fine Tuned Codegen 2B Verilog

由shailja開發
VeriGen是一個基於CodeGen-multi-2B微調的20億參數模型,專門用於生成Verilog硬件描述語言代碼。
下載量 511
發布時間 : 9/18/2022

模型概述

該模型訓練於GitHub和教科書中的Verilog代碼,能夠生成Verilog代碼片段,但不保證生成代碼的功能正確性。

模型特點

Verilog專用
專門針對Verilog硬件描述語言進行微調,能夠生成Verilog代碼片段
大上下文窗口
支持2048標記的上下文長度,適合處理較長的代碼片段
基於CodeGen優化
基於SalesForce的CodeGen-multi-2B模型進行微調,繼承了其優秀的代碼生成能力

模型能力

Verilog代碼生成
硬件設計輔助
代碼補全

使用案例

硬件設計
模塊生成
根據部分模塊頭部提示生成完整的Verilog模塊
可生成基本功能的Verilog模塊代碼
教學輔助
作為Verilog教學助手,展示代碼示例
幫助學生理解Verilog語法和結構
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